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DSP-GaTech-ECE6276A Gratis
Este proyecto desarrolla un procesador DSP optimizado para operaciones FIR/IIR/DCT. La codificación se realiza en VHDL, y está destinada a ser sintetizada por Altera Quartus II.
Este proyecto desarrolla un procesador DSP optimizado para operaciones FIR/IIR/DCT. La codificación se realiza en VHDL, y está destinada a ser sintetizada por Altera Quartus II.