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DSP-GaTech-ECE6276A

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Este proyecto desarrolla un procesador DSP optimizado para operaciones FIR/IIR/DCT. La codificación se realiza en VHDL, y está destinada a ser sintetizada por Altera Quartus II.

historial de versiones

  • Versión initial publicado en 2004-11-24
    Varias correcciones y actualizaciones
  • Versión N/A publicado en 2004-11-24

Detalles del programa

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